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模拟电路
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09-28 12:54
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北京大学 量化分析
内推 | 比特大陆2026校招-嵌入式硬件工程师 25-40k*16
关于我们: 比特大陆是全球领先的服务器厂商,旗下品牌ANTMINER在全球100多个国家和地区保持技术和市场优势。公司在低能耗计算、区块链、新能源领域有深厚的技术积累。公司的愿景是“让人类数字世界更美好”招聘优势:行业优势:横跨低能耗计算、区块链、新能源三大热门领域薪酬优势:提供市场领先型薪酬,应届生薪酬高于行业市场平均水平精英队伍:研发人员占比超59%,硕博占比超70%,985及海外名校占比近79%技术优势:全球领先的低能耗计算技术、ULSI设计技术、风水冷散热技术、高密度服务器技术招聘对象:26届海内外硕士及以上学历毕业生博士毕业生可放宽至25届工作职责1、产品的电路系统的原理性评估,设计和测试验证;2、完成或者配合Layout设计工程师完成PCB的Layout设计;3、解决产品研发及量产阶段的软硬件技术问题;4、负责Linux 嵌入式系统固件开发.移植.优化.维护,及外设模块的驱动程序开发;5、负责芯片测试与驱动程序开发,芯片测试及调试等工作;6、负责电源相关的硬件设计和软件控制算法开发。任职资格1、专业包含但不限于通信.电子.计算机.自动化.电磁与微波等相关专业;2、学习成绩优异,主动性强,学习能力强,积极上进,清晰的逻辑思维能力;3、熟悉 Linux 系统,具有嵌入式软件设计开发基础,具备较强的 C 或 C++编程能力;4、了解微处理器工作原理,具备良好的模拟电路.数字电路.电磁场与微波.信号处理的基础,具备单板硬件设计、实现、调试的经验者优先。学历要求: 硕士、博士工作地点: 北京,深圳内推链接:https://bitmain.zhiye.com/campus/detail?jobAdId=0ae562c9-3d83-4426-9b54-c8f4ff529833
投递比特大陆等公司6个岗位
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2022-12-24 02:34
蚌埠第二中学 集成电路IC设计
锁相环(PLL),以及Zynq上的PS,PL交互
PLL,全称Phase lock loop,锁相环。我主要就介绍一下它是什么以及它是如何工作的。为什么用常见的时钟电路是晶振,时钟芯片,电阻电容等器件构成,但芯片的时钟也可以由内部振荡器产生,他的输出信号频率可以到很快的速度,相对的,时钟周期就显得不太稳定了。晶振为核心的时钟电路输出的信号频率相对稳定,但频率只能是在兆赫兹的量级。PLL利用外部晶振作为参考时钟,输出一个周期稳定的高频率的时钟(做后端的一定对PLL不陌生)最基本的PLL构成如下:它有一个最主要的元件——压控振荡器VCO,VCO的振荡频率是随着输入电压变化的,它的输出就是整个PLL的输出,也就是我们最终拿到的时钟。而VCO的输出也...
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