TEC_PRE
2022-10-06 17:36 合肥工业大学 FPGA工程师
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想问一下大家，就是最后给data_b赋值的时候，为啥还再一次用到拼接呢？即 data_b <= {data_a, data_reg[5:1]};前面的6个时钟后数据不是已经全部传入data_reg了吗？可以直接根据当cnt = 5的时候， data_b <= data_reg吗？
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