一面70min项目，腾讯会议共享白板画框图，数据流，问完项目后做题1、实现多项式Y=a0+a1x+a2x²+a3x³+a4x⁴+a5x^5，要求较快速度和较省资源两种实现。2、来自未知时钟域的一个未知宽度脉冲信号，如何进行同步？3、setup和hold满足的式子4、2-1 MUX实现逻辑门最后反问二面60min，主要是聊项目，掺一些八股，然后给了两道题。问期望薪资，是否接收苏州，介绍了部门职能。1、未知时钟频率，如何确定其频率？（有一个稳定的参考时钟，例如晶振）。2、2-1 MUX实现异或。

1、site选择2、简历里写的“模块细分”具体是如何实现的？3、FPGA和ASIC设计的不同之处。4、FPGA和ASIC的RAM都是怎么实现的？5、介绍一下做的算法实现。6、功耗分析怎么做的？了解低功耗设计吗？为什么无复位寄存器功耗更低？一般用在什么上面？举一个例子。模块的休眠模式是什么？怎么实现？IO是什么状态？7、DC综合怎么看报告，关注哪些内容？8、IC设计流程中，前仿和后仿有什么不同？9、做了哪些跨时钟域处理？常用的CDC，异步FIFO为什么可以作为多bit数据CDC处理方式？10、了解DFT吗？11、项目里的功能验证怎么做的？了解IC设计中的验证是怎么做的吗（UVM）？12、同步复位和异步复位区别，同步复位最大的劣势是什么？13、自己的优势是什么。

比较专业。 1、项目FPGA选型，如何衡量资源大小？说实话我也就预估一下RAM和时钟资源和IP使用，根据接口信号估一下必要的寄存器，要预估FF和LUT真的是可以做到的吗2、所用RAM类型，大小，深度及其设置的原因？如果是ASIC会如何设置，有什么不同？3、解帧，组帧的数据流，输入输出。4、数据收发的延迟周期数？5、每次传输的数据量大小？能匹配RAM大小吗？6、关于仿真，激励怎么写的，用的什么工具？验证完备吗？验证用了多久？7、频率和位宽？实际带宽能到多少？怎么测出来的？8、有时序违例吗？CRC校验位数？CRC校验对时序的影响？9、接收有做缓存吗？处理时间够吗？考虑过反压吗？10、DC工艺库？哪些输入文件？功耗分析，有哪些组成？面积分析，时序和组合部分分别是多少？11、做了哪些约束？uncertainty设置的依据？set up和hold分别是多少？12、综合的步骤？13、反问

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