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东北大学
2025
FPGA工程师
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题解
VL16
信号反转输出
2024-10-29
答案正确
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0K
Verilog
VL1
输出1
2024-10-29
答案正确
< 1ms
0K
Verilog
VL14
对信号按位操作
2024-10-29
答案正确
< 1ms
0K
Verilog
234330
异步复位的串联T触发器
2024-10-29
答案正确
< 1ms
0K
Verilog
234329
四选一多路器
2024-10-29
答案正确
< 1ms
0K
Verilog
234329
四选一多路器
2024-10-29
答案正确
< 1ms
0K
Verilog
234313
用3-8译码器实现全减器
2024-09-23
答案正确
< 1ms
0K
Verilog
234316
根据状态转移图实现时序电路
2024-09-23
答案正确
< 1ms
0K
Verilog
234351
边沿检测
2024-09-23
答案正确
< 1ms
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Verilog
234351
边沿检测
2024-09-23
答案正确
< 1ms
0K
Verilog
234350
ROM的简单实现
2024-09-23
答案正确
< 1ms
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Verilog
234350
ROM的简单实现
2024-09-23
答案正确
< 1ms
0K
Verilog
235513
时钟切换
2024-09-03
答案正确
< 1ms
0K
Verilog
235497
序列发生器
2024-09-03
答案正确
< 1ms
0K
Verilog
235525
同步FIFO
2024-08-16
答案正确
< 1ms
0K
Verilog
235525
同步FIFO
2024-08-16
答案正确
< 1ms
0K
Verilog
235523
十六进制计数器
2024-08-16
答案正确
< 1ms
0K
Verilog
235517
超前进位加法器
2024-08-16
答案正确
< 1ms
0K
Verilog
235515
状态机与时钟分频
2024-08-15
答案正确
< 1ms
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Verilog
235515
状态机与时钟分频
2024-08-15
答案正确
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Verilog

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